mb/amd/chausie: Add EC support
Add support for the chausie EC. Use EC to configure default board GPIO settings. Change-Id: I3e59e17644cddf1a508614f90c20561bde2691fb Signed-off-by: Fred Reitberger <reitbergerfred@gmail.com> Reviewed-on: https://review.coreboot.org/c/coreboot/+/63794 Tested-by: build bot (Jenkins) <no-reply@coreboot.org> Reviewed-by: Felix Held <felix-coreboot@felixheld.de>
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6e184e6bdf
commit
19788cd9a4
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@ -6,6 +6,7 @@ config BOARD_SPECIFIC_OPTIONS
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def_bool y
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def_bool y
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select BOARD_ROMSIZE_KB_16384
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select BOARD_ROMSIZE_KB_16384
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select HAVE_ACPI_RESUME
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select HAVE_ACPI_RESUME
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select EC_ACPI
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select SOC_AMD_SABRINA
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select SOC_AMD_SABRINA
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select SOC_AMD_COMMON_BLOCK_USE_ESPI
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select SOC_AMD_COMMON_BLOCK_USE_ESPI
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select AMD_SOC_CONSOLE_UART
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select AMD_SOC_CONSOLE_UART
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@ -2,6 +2,7 @@
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bootblock-y += bootblock.c
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bootblock-y += bootblock.c
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bootblock-y += early_gpio.c
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bootblock-y += early_gpio.c
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bootblock-y += ec.c
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romstage-y += port_descriptors.c
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romstage-y += port_descriptors.c
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@ -2,6 +2,7 @@
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#include <bootblock_common.h>
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#include <bootblock_common.h>
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#include <soc/espi.h>
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#include <soc/espi.h>
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#include "ec.h"
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#include "gpio.h"
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#include "gpio.h"
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void bootblock_mainboard_early_init(void)
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void bootblock_mainboard_early_init(void)
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@ -10,3 +11,8 @@ void bootblock_mainboard_early_init(void)
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espi_switch_to_spi1_pads();
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espi_switch_to_spi1_pads();
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}
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}
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void bootblock_mainboard_init(void)
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{
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chausie_ec_init();
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}
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@ -2,7 +2,15 @@
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chip soc/amd/sabrina
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chip soc/amd/sabrina
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register "common_config.espi_config" = "{
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register "common_config.espi_config" = "{
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||||||
.std_io_decode_bitmap = ESPI_DECODE_IO_0x80_EN | ESPI_DECODE_IO_0X2E_0X2F_EN,
|
.std_io_decode_bitmap = ESPI_DECODE_IO_0x80_EN | ESPI_DECODE_IO_0X2E_0X2F_EN | ESPI_DECODE_IO_0X60_0X64_EN,
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||||||
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.generic_io_range[0] = {
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.base = 0x3f8,
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.size = 8,
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},
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.generic_io_range[1] = {
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.base = 0x600,
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||||||
|
.size = 256,
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|
},
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.io_mode = ESPI_IO_MODE_QUAD,
|
.io_mode = ESPI_IO_MODE_QUAD,
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||||||
.op_freq_mhz = ESPI_OP_FREQ_16_MHZ,
|
.op_freq_mhz = ESPI_OP_FREQ_16_MHZ,
|
||||||
.crc_check_enable = 1,
|
.crc_check_enable = 1,
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||||||
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@ -0,0 +1,58 @@
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/* SPDX-License-Identifier: GPL-2.0-only */
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#include <ec/acpi/ec.h>
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#include "ec.h"
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#define CHAUSIE_EC_CMD 0x666
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#define CHAUSIE_EC_DATA 0x662
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#define EC_GPIO_3_ADDR 0xA3
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#define EC_GPIO_LOM_RESET_AUX (1 << 1)
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#define EC_GPIO_7_ADDR 0xA7
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#define EC_GPIO_DT_PWREN (1 << 2)
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#define EC_GPIO_WWAN_MODULE_RST (1 << 5)
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#define EC_GPIO_8_ADDR 0xA8
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#define EC_GPIO_SMBUS0_EN (1 << 0)
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#define EC_GPIO_A_ADDR 0xAA
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#define EC_GPIO_WWAN_PWREN (1 << 3)
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#define EC_GPIO_M2_SSD0_PWREN (1 << 6)
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#define EC_GPIO_LOM_PWREN (1 << 7)
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#define EC_GPIO_C_ADDR 0xAC
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#define EC_GPIO_DT_N_WLAN_SW (1 << 1)
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#define EC_GPIO_MP2_SEL (1 << 2)
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#define EC_GPIO_WWAN_N_LOM_SW (1 << 3)
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static void configure_ec_gpio(void)
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{
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uint8_t tmp;
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tmp = ec_read(EC_GPIO_3_ADDR);
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tmp |= EC_GPIO_LOM_RESET_AUX;
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|
ec_write(EC_GPIO_3_ADDR, tmp);
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||||||
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||||||
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tmp = ec_read(EC_GPIO_7_ADDR);
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||||||
|
tmp |= EC_GPIO_WWAN_MODULE_RST | EC_GPIO_DT_PWREN;
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||||||
|
ec_write(EC_GPIO_7_ADDR, tmp);
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||||||
|
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||||||
|
tmp = ec_read(EC_GPIO_8_ADDR);
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||||||
|
tmp |= EC_GPIO_SMBUS0_EN;
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||||||
|
ec_write(EC_GPIO_8_ADDR, tmp);
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||||||
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||||||
|
tmp = ec_read(EC_GPIO_A_ADDR);
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||||||
|
tmp |= EC_GPIO_M2_SSD0_PWREN | EC_GPIO_LOM_PWREN | EC_GPIO_WWAN_PWREN;
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||||||
|
ec_write(EC_GPIO_A_ADDR, tmp);
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||||||
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||||||
|
tmp = ec_read(EC_GPIO_C_ADDR);
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||||||
|
tmp |= EC_GPIO_WWAN_N_LOM_SW | EC_GPIO_MP2_SEL | EC_GPIO_DT_N_WLAN_SW;
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||||||
|
ec_write(EC_GPIO_C_ADDR, tmp);
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|
}
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void chausie_ec_init(void)
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{
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ec_set_ports(CHAUSIE_EC_CMD, CHAUSIE_EC_DATA);
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||||||
|
configure_ec_gpio();
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||||||
|
}
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@ -0,0 +1,8 @@
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|
/* SPDX-License-Identifier: GPL-2.0-only */
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||||||
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#ifndef CHAUSIE_EC_H
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#define CHAUSIE_EC_H
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void chausie_ec_init(void);
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||||||
|
#endif /* CHAUSIE_EC_H */
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