Replace dual_core and quad_core CMOS (nvram) options with multi_core. Fix some white space.
Signed-off-by: Myles Watson <mylesgw@gmail.com> Acked-by: Myles Watson <mylesgw@gmail.com> git-svn-id: svn://svn.coreboot.org/coreboot/trunk@5380 2b7e53f0-3cfb-0310-b3e9-8179ed1497e1
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parent
604877eb2a
commit
4839e2c495
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@ -61,7 +61,7 @@ unsigned get_apicid_base(unsigned ioapic_num)
|
|||
unsigned nb_cfg_54;
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||||
int bsp_apic_id = lapicid(); // bsp apicid
|
||||
|
||||
get_option(&disable_siblings, "dual_core");
|
||||
get_option(&disable_siblings, "multi_core");
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||||
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||||
//get the nodes number
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||||
dev = dev_find_slot(0, PCI_DEVFN(0x18,0));
|
||||
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@ -129,7 +129,7 @@ void amd_sibling_init(device_t cpu)
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|||
/* On the bootstrap processor see if I want sibling cpus enabled */
|
||||
if (first_time) {
|
||||
first_time = 0;
|
||||
get_option(&disable_siblings, "dual_core");
|
||||
get_option(&disable_siblings, "multi_core");
|
||||
}
|
||||
result = cpuid(0x80000008);
|
||||
/* See how many sibling cpus we have */
|
||||
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@ -57,8 +57,8 @@ static inline void start_other_cores(void)
|
|||
unsigned nodeid;
|
||||
|
||||
if (CONFIG_HAVE_OPTION_TABLE &&
|
||||
read_option(CMOS_VSTART_dual_core, CMOS_VLEN_dual_core, 0) != 0) {
|
||||
return; // disable dual_core
|
||||
read_option(CMOS_VSTART_multi_core, CMOS_VLEN_multi_core, 0) != 0) {
|
||||
return; // disable multi_core
|
||||
}
|
||||
|
||||
nodes = get_nodes();
|
||||
|
|
|
@ -131,7 +131,7 @@ static void for_each_ap(u32 bsp_apicid, u32 core_range,
|
|||
disable_siblings = !CONFIG_LOGICAL_CPUS;
|
||||
|
||||
#if CONFIG_LOGICAL_CPUS == 1
|
||||
if(read_option(CMOS_VSTART_quad_core, CMOS_VLEN_quad_core, 0) != 0) { // 0 mean quad core
|
||||
if(read_option(CMOS_VSTART_multi_core, CMOS_VLEN_multi_core, 0) != 0) { // 0 mean multi core
|
||||
disable_siblings = 1;
|
||||
}
|
||||
#endif
|
||||
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@ -57,7 +57,7 @@ static void for_each_ap(unsigned bsp_apicid, unsigned core_range, process_ap_t p
|
|||
|
||||
disable_siblings = !CONFIG_LOGICAL_CPUS;
|
||||
#if CONFIG_LOGICAL_CPUS == 1 && CONFIG_HAVE_OPTION_TABLE == 1
|
||||
if(read_option(CMOS_VSTART_dual_core, CMOS_VLEN_dual_core, 0) != 0) { // 0 mean dual core
|
||||
if(read_option(CMOS_VSTART_multi_core, CMOS_VLEN_multi_core, 0) != 0) { // 0 mean multi core
|
||||
disable_siblings = 1;
|
||||
}
|
||||
#endif
|
||||
|
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|
@ -82,7 +82,7 @@ u32 get_apicid_base(u32 ioapic_num)
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|||
|
||||
u32 disable_siblings = !CONFIG_LOGICAL_CPUS;
|
||||
|
||||
get_option(&disable_siblings, "quad_core");
|
||||
get_option(&disable_siblings, "multi_core");
|
||||
|
||||
siblings = get_max_siblings(sysconf.nodes);
|
||||
|
||||
|
|
|
@ -86,8 +86,8 @@ static void start_other_cores(void)
|
|||
u32 nodes;
|
||||
u32 nodeid;
|
||||
|
||||
// disable quad_core
|
||||
if (read_option(CMOS_VSTART_quad_core, CMOS_VLEN_quad_core, 0) != 0) {
|
||||
// disable multi_core
|
||||
if (read_option(CMOS_VSTART_multi_core, CMOS_VLEN_multi_core, 0) != 0) {
|
||||
printk(BIOS_DEBUG, "Skip additional core init\n");
|
||||
return;
|
||||
}
|
||||
|
|
|
@ -35,7 +35,7 @@ entries
|
|||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
1008 16 h 0 check_sum
|
||||
|
||||
enumerations
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@ -53,14 +53,14 @@ entries
|
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395 1 e 1 hw_scrubber
|
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396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
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440 4 e 9 slow_cpu
|
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444 1 e 1 nmi
|
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445 1 e 1 iommu
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@ -53,14 +53,14 @@ entries
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395 1 e 1 hw_scrubber
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
|
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399 1 e 2 dual_core
|
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399 1 e 2 multi_core
|
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
|
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416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
|
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440 4 e 9 slow_cpu
|
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444 1 e 1 nmi
|
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445 1 e 1 iommu
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@ -32,14 +32,14 @@ entries
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396 1 e 1 interleave_chip_selects
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||||
397 2 e 8 max_mem_clock
|
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399 1 e 2 quad_core
|
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399 1 e 2 multi_core
|
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
|
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416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
|
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440 4 e 9 slow_cpu
|
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444 1 e 1 nmi
|
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445 1 e 1 iommu
|
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|
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@ -35,8 +35,8 @@ entries
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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440 1 e 0 dcon_present
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432 8 h 0 boot_countdown
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440 1 e 0 dcon_present
|
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1008 16 h 0 check_sum
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enumerations
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@ -53,14 +53,14 @@ entries
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 dual_core
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
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416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
|
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440 4 e 9 slow_cpu
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444 1 e 1 nmi
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445 1 e 1 iommu
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
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1008 16 h 0 check_sum
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enumerations
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@ -32,14 +32,14 @@ entries
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396 1 e 1 interleave_chip_selects
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|
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399 1 e 2 dual_core
|
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
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444 1 e 1 nmi
|
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445 1 e 1 iommu
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@ -32,14 +32,14 @@ entries
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
|
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
|
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|
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444 1 e 1 nmi
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445 1 e 1 iommu
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@ -32,14 +32,14 @@ entries
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 multi_core
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|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
|
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|
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445 1 e 1 iommu
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
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1008 16 h 0 check_sum
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 dual_core
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
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416 4 e 7 boot_first
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
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444 1 e 1 nmi
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@ -31,7 +31,7 @@ entries
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396 1 e 1 interleave_chip_selects
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399 1 e 2 multi_core
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
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416 4 e 7 boot_first
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@ -32,7 +32,7 @@ entries
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
|
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399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
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400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
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416 4 e 7 boot_first
|
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|
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
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1008 16 h 0 check_sum
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|
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enumerations
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
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1008 16 h 0 check_sum
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enumerations
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@ -32,14 +32,14 @@ entries
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
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400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
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416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
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440 4 e 9 slow_cpu
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444 1 e 1 nmi
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445 1 e 1 iommu
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@ -36,7 +36,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
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432 8 h 0 boot_countdown
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# Reserve the extended AMD configuration registers
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
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1008 16 h 0 check_sum
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enumerations
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
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||||
1008 16 h 0 check_sum
|
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|
||||
enumerations
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|
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@ -35,7 +35,7 @@ entries
|
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420 4 e 7 boot_second
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
1008 16 h 0 check_sum
|
||||
|
||||
enumerations
|
||||
|
|
|
@ -35,7 +35,7 @@ entries
|
|||
420 4 e 7 boot_second
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
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||||
1008 16 h 0 check_sum
|
||||
|
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enumerations
|
||||
|
|
|
@ -35,7 +35,7 @@ entries
|
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420 4 e 7 boot_second
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
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1008 16 h 0 check_sum
|
||||
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enumerations
|
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|
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|
@ -53,14 +53,14 @@ entries
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395 1 e 1 hw_scrubber
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
|
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416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
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440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
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445 1 e 1 iommu
|
||||
|
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@ -53,14 +53,14 @@ entries
|
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395 1 e 1 hw_scrubber
|
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396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
|
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416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
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440 4 e 9 slow_cpu
|
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444 1 e 1 nmi
|
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445 1 e 1 iommu
|
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|
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@ -32,14 +32,14 @@ entries
|
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395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
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440 4 e 9 slow_cpu
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444 1 e 1 nmi
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445 1 e 1 iommu
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@ -32,14 +32,14 @@ entries
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
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416 4 e 7 boot_first
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
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432 8 h 0 boot_countdown
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440 4 e 9 slow_cpu
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444 1 e 1 nmi
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@ -32,14 +32,14 @@ entries
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 dual_core
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
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416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
|
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440 4 e 9 slow_cpu
|
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444 1 e 1 nmi
|
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445 1 e 1 iommu
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|
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
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1008 16 h 0 check_sum
|
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|
||||
enumerations
|
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|
|
|
@ -35,7 +35,7 @@ entries
|
|||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
1008 16 h 0 check_sum
|
||||
|
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enumerations
|
||||
|
|
|
@ -24,7 +24,7 @@ entries
|
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#95 1 r 0 disable_clock_updates
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#96 288 r 0 temporary_filler
|
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0 376 r 0 reserved_memory
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376 1 e 1 power_up_watchdog
|
||||
376 1 e 1 power_up_watchdog
|
||||
384 1 e 4 boot_option
|
||||
385 1 e 4 last_boot
|
||||
386 1 e 1 ECC_memory
|
||||
|
@ -38,7 +38,7 @@ entries
|
|||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
728 256 h 0 user_data
|
||||
984 16 h 0 check_sum
|
||||
# Reserve the extended AMD configuration registers
|
||||
|
|
|
@ -1,16 +1,16 @@
|
|||
# NOTE: This file must be in UNIX format (not DOS) or build_opt_tbl fails:
|
||||
# "Error - Name is an invalid identifier in line"
|
||||
# "Error - Name is an invalid identifier in line"
|
||||
|
||||
entries
|
||||
|
||||
#start-bit length config config-ID name
|
||||
0 512 r 0 reserved_memory1 # We know nothing about the factory BIOS
|
||||
512 512 r 0 reserved_memory2 # More factory BIOS
|
||||
0 512 r 0 reserved_memory1 # We know nothing about the factory BIOS
|
||||
512 512 r 0 reserved_memory2 # More factory BIOS
|
||||
|
||||
# Work in progress.
|
||||
# This is where we would put the LB RTC_BOOT_BYTE options once the code
|
||||
# supports finding them there.
|
||||
#1024 1 e 4 boot_option
|
||||
#1024 1 e 4 boot_option
|
||||
#1025 1 e 4 last_boot
|
||||
#1026 1 e 1 ECC_memory
|
||||
#1028 4 r 0 reboot_bits
|
||||
|
|
|
@ -32,14 +32,14 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
||||
445 1 e 1 iommu
|
||||
|
|
|
@ -32,14 +32,14 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
||||
445 1 e 1 iommu
|
||||
|
|
|
@ -32,14 +32,14 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
||||
445 1 e 1 iommu
|
||||
|
|
|
@ -35,7 +35,7 @@ entries
|
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420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
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1008 16 h 0 check_sum
|
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|
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enumerations
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@ -53,14 +53,14 @@ entries
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395 1 e 1 hw_scrubber
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396 1 e 1 interleave_chip_selects
|
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397 2 e 8 max_mem_clock
|
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399 1 e 2 dual_core
|
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399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
||||
445 1 e 1 iommu
|
||||
|
|
|
@ -35,7 +35,7 @@ entries
|
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420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
1008 16 h 0 check_sum
|
||||
|
||||
enumerations
|
||||
|
|
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@ -32,14 +32,14 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
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396 1 e 1 interleave_chip_selects
|
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397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
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445 1 e 1 iommu
|
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|
|
|
@ -54,14 +54,14 @@ entries
|
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395 1 e 1 hw_scrubber
|
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396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
||||
445 1 e 1 iommu
|
||||
|
|
|
@ -32,7 +32,7 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
|
|
|
@ -32,7 +32,7 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
|
|
|
@ -53,7 +53,7 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 quad_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
|
|
|
@ -32,14 +32,14 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
||||
396 1 e 1 interleave_chip_selects
|
||||
397 2 e 8 max_mem_clock
|
||||
399 1 e 2 dual_core
|
||||
399 1 e 2 multi_core
|
||||
400 1 e 1 power_on_after_fail
|
||||
412 4 e 6 debug_level
|
||||
416 4 e 7 boot_first
|
||||
420 4 e 7 boot_second
|
||||
424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
||||
445 1 e 1 iommu
|
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|
|
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@ -53,7 +53,7 @@ entries
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395 1 e 1 hw_scrubber
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396 1 e 1 interleave_chip_selects
|
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397 2 e 8 max_mem_clock
|
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399 1 e 2 dual_core
|
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399 1 e 2 multi_core
|
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
|
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416 4 e 7 boot_first
|
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|
|
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@ -35,8 +35,8 @@ entries
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
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428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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440 1 e 0 dcon_present
|
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432 8 h 0 boot_countdown
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440 1 e 0 dcon_present
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1008 16 h 0 check_sum
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|
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enumerations
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|
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@ -35,8 +35,8 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
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440 1 e 0 dcon_present
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432 8 h 0 boot_countdown
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440 1 e 0 dcon_present
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1008 16 h 0 check_sum
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enumerations
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|
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
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432 8 h 0 boot_countdown
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1008 16 h 0 check_sum
|
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|
||||
enumerations
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@ -32,14 +32,14 @@ entries
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395 1 e 1 hw_scrubber
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 dual_core
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
|
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416 4 e 7 boot_first
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
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432 8 h 0 boot_countdown
|
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432 8 h 0 boot_countdown
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440 4 e 9 slow_cpu
|
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444 1 e 1 nmi
|
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445 1 e 1 iommu
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@ -53,14 +53,14 @@ entries
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395 1 e 1 hw_scrubber
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 dual_core
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
|
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412 4 e 6 debug_level
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416 4 e 7 boot_first
|
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420 4 e 7 boot_second
|
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424 4 e 7 boot_third
|
||||
428 4 h 0 boot_index
|
||||
432 8 h 0 boot_countdown
|
||||
432 8 h 0 boot_countdown
|
||||
440 4 e 9 slow_cpu
|
||||
444 1 e 1 nmi
|
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445 1 e 1 iommu
|
||||
|
|
|
@ -53,14 +53,14 @@ entries
|
|||
395 1 e 1 hw_scrubber
|
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396 1 e 1 interleave_chip_selects
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397 2 e 8 max_mem_clock
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399 1 e 2 dual_core
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399 1 e 2 multi_core
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400 1 e 1 power_on_after_fail
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412 4 e 6 debug_level
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enumerations
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
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432 8 h 0 boot_countdown
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1008 16 h 0 check_sum
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enumerations
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
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432 8 h 0 boot_countdown
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1008 16 h 0 check_sum
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||||
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||||
enumerations
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@ -35,7 +35,7 @@ entries
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420 4 e 7 boot_second
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424 4 e 7 boot_third
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428 4 h 0 boot_index
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432 8 h 0 boot_countdown
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432 8 h 0 boot_countdown
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||||
1008 16 h 0 check_sum
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||||
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||||
enumerations
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@ -1234,7 +1234,7 @@ static u32 cpu_bus_scan(device_t dev, u32 max)
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||||
disable_siblings = !CONFIG_LOGICAL_CPUS;
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||||
#if CONFIG_LOGICAL_CPUS == 1
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get_option(&disable_siblings, "quad_core");
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||||
get_option(&disable_siblings, "multi_core");
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||||
#endif
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||||
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||||
// for pre_e0, nb_cfg_54 can not be set, ( even set, when you read it
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||||
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@ -1595,7 +1595,7 @@ static void coherent_ht_finalize(unsigned nodes)
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unsigned total_cpus;
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if ((!CONFIG_HAVE_OPTION_TABLE) ||
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||||
read_option(CMOS_VSTART_dual_core, CMOS_VLEN_dual_core, 0) == 0) { /* dual_core */
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||||
read_option(CMOS_VSTART_multi_core, CMOS_VLEN_multi_core, 0) == 0) { /* multi_core */
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||||
total_cpus = verify_dualcore(nodes);
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||||
}
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||||
else {
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||||
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@ -1142,7 +1142,7 @@ static unsigned int cpu_bus_scan(device_t dev, unsigned int max)
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|||
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||||
disable_siblings = !CONFIG_LOGICAL_CPUS;
|
||||
#if CONFIG_LOGICAL_CPUS == 1
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||||
get_option(&disable_siblings, "dual_core");
|
||||
get_option(&disable_siblings, "multi_core");
|
||||
#endif
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||||
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||||
// for pre_e0, nb_cfg_54 can not be set, ( even set, when you read it still be 0)
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||||
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