Do sdram setup for fixed memory sizes. This really only works on
embedded boards that have fixed memory configuration. git-svn-id: svn://svn.coreboot.org/coreboot/trunk@1240 2b7e53f0-3cfb-0310-b3e9-8179ed1497e1
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Greg Watson
parent
6f2e86d278
commit
5bcd408b8e
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@ -24,31 +24,14 @@
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#include <ppc_asm.tmpl>
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#include <ppc_asm.tmpl>
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#include <ppc.h>
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#include <ppc.h>
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#include <ppc4xx.h>
|
#include <ppc4xx.h>
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#include <timer.h>
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#include <clock.h>
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#define CONFIG_SDRAM_BANK0
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#define CONFIG_SDRAM_BANK0
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#ifdef CONFIG_SDRAM_BANK0
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#ifdef CONFIG_SDRAM_BANK0
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#define MAGIC0 0x00000000
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#define MAGIC1 0x11111111
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#define MAGIC2 0x22222222
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#define MAGIC3 0x33333333
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#define MAGIC4 0x44444444
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#define MAGIC5 0x55555555
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#define MAGIC6 0x66666666
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#define ADDR_ZERO 0x00000000
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#define ADDR_400 0x00000400
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#define ADDR_01MB 0x00100000
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#define ADDR_08MB 0x00800000
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#define ADDR_16MB 0x01000000
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#define ADDR_32MB 0x02000000
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#define ADDR_64MB 0x04000000
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#define ADDR_128MB 0x08000000
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||||||
#define mtsdram0(reg, data) mtdcr(memcfga,reg);mtdcr(memcfgd,data)
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#define mtsdram0(reg, data) mtdcr(memcfga,reg);mtdcr(memcfgd,data)
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/*-----------------------------------------------------------------------
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/*-----------------------------------------------------------------------
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*/
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*/
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void sdram_init(void)
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void sdram_init(void)
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@ -60,7 +43,7 @@ void sdram_init(void)
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/*
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/*
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||||||
* Determine SDRAM speed
|
* Determine SDRAM speed
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||||||
*/
|
*/
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speed = get_bus_freq(0); /* parameter not used on ppc4xx */
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speed = get_bus_freq(); /* parameter not used on ppc4xx */
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||||||
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/*
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/*
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||||||
* Support for 100MHz and 133MHz SDRAM
|
* Support for 100MHz and 133MHz SDRAM
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@ -79,6 +62,13 @@ void sdram_init(void)
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||||||
rtr = 0x05f00000;
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rtr = 0x05f00000;
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}
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}
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/*
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* Disable memory controller.
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*/
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/* TODO: work out why this trashes cache ram */
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//mtsdram0(mem_mcopt1, 0x00000000);
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||||||
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||||||
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#if EMBEDDED_RAM_SIZE==128*1024*1024
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||||||
/*
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/*
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||||||
* Set MB0CF for bank 0. (0-128MB) Address Mode 3 since 13x10(4)
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* Set MB0CF for bank 0. (0-128MB) Address Mode 3 since 13x10(4)
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||||||
*/
|
*/
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||||||
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@ -86,52 +76,7 @@ void sdram_init(void)
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||||||
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||||||
mtsdram0(mem_sdtr1, sdtr1);
|
mtsdram0(mem_sdtr1, sdtr1);
|
||||||
mtsdram0(mem_rtr, rtr);
|
mtsdram0(mem_rtr, rtr);
|
||||||
|
#elif EMBEDDED_RAM_SIZE==64*1024*1024
|
||||||
/*
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||||||
* Wait for 200us
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||||||
*/
|
|
||||||
udelay(200);
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||||||
|
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||||||
/*
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||||||
* Set memory controller options reg, MCOPT1.
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||||||
* Set DC_EN to '1' and BRD_PRF to '01' for 16 byte PLB Burst
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||||||
* read/prefetch.
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||||||
*/
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||||||
mtsdram0(mem_mcopt1, 0x80800000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Wait for 10ms
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||||||
*/
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||||||
udelay(10000);
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||||||
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||||||
/*
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||||||
* Test if 128 MByte are equipped (mirror test)
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||||||
*/
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||||||
*(volatile unsigned long *)ADDR_ZERO = MAGIC0;
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||||||
*(volatile unsigned long *)ADDR_08MB = MAGIC1;
|
|
||||||
*(volatile unsigned long *)ADDR_16MB = MAGIC2;
|
|
||||||
*(volatile unsigned long *)ADDR_32MB = MAGIC3;
|
|
||||||
*(volatile unsigned long *)ADDR_64MB = MAGIC4;
|
|
||||||
|
|
||||||
if ((*(volatile unsigned long *)ADDR_ZERO == MAGIC0) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_08MB == MAGIC1) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_16MB == MAGIC2) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_32MB == MAGIC3)) {
|
|
||||||
/*
|
|
||||||
* OK, 128MB detected -> all done
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||||||
*/
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|
||||||
return;
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||||||
}
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||||||
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||||||
/*
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||||||
* Now test for 64 MByte...
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||||||
*/
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||||||
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||||||
/*
|
|
||||||
* Disable memory controller.
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||||||
*/
|
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||||||
mtsdram0(mem_mcopt1, 0x00000000);
|
|
||||||
|
|
||||||
/*
|
/*
|
||||||
* Set MB0CF for bank 0. (0-64MB) Address Mode 3 since 13x9(4)
|
* Set MB0CF for bank 0. (0-64MB) Address Mode 3 since 13x9(4)
|
||||||
*/
|
*/
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||||||
|
|
@ -139,6 +84,17 @@ void sdram_init(void)
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||||||
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||||||
mtsdram0(mem_sdtr1, sdtr1);
|
mtsdram0(mem_sdtr1, sdtr1);
|
||||||
mtsdram0(mem_rtr, rtr);
|
mtsdram0(mem_rtr, rtr);
|
||||||
|
#elif EMBEDDED_RAM_SIZE==32*1024*1024
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||||||
|
/*
|
||||||
|
* Set MB0CF for bank 0. (0-32MB) Address Mode 2 since 12x9(4)
|
||||||
|
*/
|
||||||
|
mtsdram0(mem_mb0cf, 0x00062001);
|
||||||
|
#elif EMBEDDED_RAM_SIZE==16*1024*1024
|
||||||
|
/*
|
||||||
|
* Set MB0CF for bank 0. (0-16MB) Address Mode 4 since 12x8(4)
|
||||||
|
*/
|
||||||
|
mtsdram0(mem_mb0cf, 0x00046001);
|
||||||
|
#endif
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||||||
|
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||||||
/*
|
/*
|
||||||
* Wait for 200us
|
* Wait for 200us
|
||||||
|
|
@ -156,136 +112,6 @@ void sdram_init(void)
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||||||
* Wait for 10ms
|
* Wait for 10ms
|
||||||
*/
|
*/
|
||||||
udelay(10000);
|
udelay(10000);
|
||||||
|
|
||||||
/*
|
|
||||||
* Test if 64 MByte are equipped (mirror test)
|
|
||||||
*/
|
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||||||
*(volatile unsigned long *)ADDR_ZERO = MAGIC0;
|
|
||||||
*(volatile unsigned long *)ADDR_08MB = MAGIC1;
|
|
||||||
*(volatile unsigned long *)ADDR_16MB = MAGIC2;
|
|
||||||
*(volatile unsigned long *)ADDR_32MB = MAGIC3;
|
|
||||||
|
|
||||||
if ((*(volatile unsigned long *)ADDR_ZERO == MAGIC0) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_08MB == MAGIC1) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_16MB == MAGIC2)) {
|
|
||||||
/*
|
|
||||||
* OK, 64MB detected -> all done
|
|
||||||
*/
|
|
||||||
return;
|
|
||||||
}
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Now test for 32 MByte...
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||||||
*/
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Disable memory controller.
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mcopt1, 0x00000000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Set MB0CF for bank 0. (0-32MB) Address Mode 2 since 12x9(4)
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mb0cf, 0x00062001);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Set memory controller options reg, MCOPT1.
|
|
||||||
* Set DC_EN to '1' and BRD_PRF to '01' for 16 byte PLB Burst
|
|
||||||
* read/prefetch.
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mcopt1, 0x80800000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Wait for 10ms
|
|
||||||
*/
|
|
||||||
udelay(10000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Test if 32 MByte are equipped (mirror test)
|
|
||||||
*/
|
|
||||||
*(volatile unsigned long *)ADDR_ZERO = MAGIC0;
|
|
||||||
*(volatile unsigned long *)ADDR_400 = MAGIC1;
|
|
||||||
*(volatile unsigned long *)ADDR_08MB = MAGIC2;
|
|
||||||
*(volatile unsigned long *)ADDR_16MB = MAGIC3;
|
|
||||||
|
|
||||||
if ((*(volatile unsigned long *)ADDR_ZERO == MAGIC0) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_400 == MAGIC1) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_08MB == MAGIC2)) {
|
|
||||||
/*
|
|
||||||
* OK, 32MB detected -> all done
|
|
||||||
*/
|
|
||||||
return;
|
|
||||||
}
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Now test for 16 MByte...
|
|
||||||
*/
|
|
||||||
/*
|
|
||||||
* Disable memory controller.
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mcopt1, 0x00000000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Set MB0CF for bank 0. (0-16MB) Address Mode 4 since 12x8(4)
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mb0cf, 0x00046001);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Set memory controller options reg, MCOPT1.
|
|
||||||
* Set DC_EN to '1' and BRD_PRF to '01' for 16 byte PLB Burst
|
|
||||||
* read/prefetch.
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mcopt1, 0x80800000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Wait for 10ms
|
|
||||||
*/
|
|
||||||
udelay(10000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Test if 16 MByte are equipped (mirror test)
|
|
||||||
*/
|
|
||||||
*(volatile unsigned long *)ADDR_ZERO = MAGIC0;
|
|
||||||
*(volatile unsigned long *)ADDR_400 = MAGIC1;
|
|
||||||
*(volatile unsigned long *)ADDR_01MB = MAGIC5;
|
|
||||||
*(volatile unsigned long *)ADDR_08MB = MAGIC2;
|
|
||||||
/* *(volatile unsigned long *)ADDR_16MB = MAGIC3;*/
|
|
||||||
|
|
||||||
if ((*(volatile unsigned long *)ADDR_ZERO == MAGIC0) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_400 == MAGIC1) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_01MB == MAGIC5) &&
|
|
||||||
(*(volatile unsigned long *)ADDR_08MB == MAGIC2)) {
|
|
||||||
/*
|
|
||||||
* OK, 16MB detected -> all done
|
|
||||||
*/
|
|
||||||
return;
|
|
||||||
}
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Setup for 4 MByte...
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|
||||||
*/
|
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||||||
|
|
||||||
/*
|
|
||||||
* Disable memory controller.
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mcopt1, 0x00000000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Set MB0CF for bank 0. (0-4MB) Address Mode 5 since 11x8(2)
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mb0cf, 0x00008001);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Set memory controller options reg, MCOPT1.
|
|
||||||
* Set DC_EN to '1' and BRD_PRF to '01' for 16 byte PLB Burst
|
|
||||||
* read/prefetch.
|
|
||||||
*/
|
|
||||||
mtsdram0(mem_mcopt1, 0x80800000);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Wait for 10ms
|
|
||||||
*/
|
|
||||||
udelay(10000);
|
|
||||||
}
|
}
|
||||||
|
|
||||||
#endif /* CONFIG_SDRAM_BANK0 */
|
#endif /* CONFIG_SDRAM_BANK0 */
|
||||||
|
|
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