mb/asus/p5gc-mx: Use common/gpio.h
Should have been included in 62902ca45d "sb/ich7: Use common/gpio.h to
set up GPIOs", which was not rebased on addition of this board.
Change-Id: If4547ee43ce6a7a6e4af67e9364613e48f989401
Signed-off-by: Arthur Heymans <arthur@aheymans.xyz>
Reviewed-on: https://review.coreboot.org/18047
Reviewed-by: Martin Roth <martinroth@google.com>
Tested-by: build bot (Jenkins)
This commit is contained in:
Arthur Heymans
Martin Roth
parent
b5623dede7
commit
8f8d56dded
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@ -1 +1,3 @@
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ramstage-y += cstates.c
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romstage-y += gpio.c
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@ -0,0 +1,129 @@
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/*
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* This file is part of the coreboot project.
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*
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* Copyright (C) 2016 Arthur Heymans <arthur@aheymans.xyz>
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*
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* This program is free software; you can redistribute it and/or modify
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* it under the terms of the GNU General Public License as published by
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* the Free Software Foundation; version 2 of the License.
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||||
*
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* This program is distributed in the hope that it will be useful,
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||||
* but WITHOUT ANY WARRANTY; without even the implied warranty of
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* MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
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* GNU General Public License for more details.
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*/
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#include <southbridge/intel/common/gpio.h>
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const struct pch_gpio_set1 pch_gpio_set1_mode = {
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||||
.gpio0 = GPIO_MODE_GPIO,
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||||
.gpio6 = GPIO_MODE_GPIO,
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||||
.gpio7 = GPIO_MODE_GPIO,
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.gpio8 = GPIO_MODE_GPIO,
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.gpio9 = GPIO_MODE_GPIO,
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.gpio10 = GPIO_MODE_GPIO,
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||||
.gpio11 = GPIO_MODE_GPIO,
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.gpio12 = GPIO_MODE_GPIO,
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||||
.gpio13 = GPIO_MODE_GPIO,
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||||
.gpio14 = GPIO_MODE_GPIO,
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||||
.gpio15 = GPIO_MODE_GPIO,
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||||
.gpio16 = GPIO_MODE_GPIO,
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.gpio18 = GPIO_MODE_GPIO,
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||||
.gpio19 = GPIO_MODE_GPIO,
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||||
.gpio20 = GPIO_MODE_GPIO,
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||||
.gpio21 = GPIO_MODE_GPIO,
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||||
.gpio24 = GPIO_MODE_GPIO,
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||||
.gpio25 = GPIO_MODE_GPIO,
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||||
.gpio26 = GPIO_MODE_GPIO,
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||||
.gpio27 = GPIO_MODE_GPIO,
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||||
.gpio28 = GPIO_MODE_GPIO,
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};
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const struct pch_gpio_set1 pch_gpio_set1_direction = {
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||||
.gpio0 = GPIO_DIR_OUTPUT,
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||||
.gpio6 = GPIO_DIR_INPUT,
|
||||
.gpio7 = GPIO_DIR_INPUT,
|
||||
.gpio8 = GPIO_DIR_INPUT,
|
||||
.gpio9 = GPIO_DIR_INPUT,
|
||||
.gpio10 = GPIO_DIR_INPUT,
|
||||
.gpio11 = GPIO_DIR_OUTPUT,
|
||||
.gpio12 = GPIO_DIR_INPUT,
|
||||
.gpio13 = GPIO_DIR_INPUT,
|
||||
.gpio14 = GPIO_DIR_INPUT,
|
||||
.gpio15 = GPIO_DIR_INPUT,
|
||||
.gpio16 = GPIO_DIR_OUTPUT,
|
||||
.gpio18 = GPIO_DIR_OUTPUT,
|
||||
.gpio19 = GPIO_DIR_INPUT,
|
||||
.gpio20 = GPIO_DIR_OUTPUT,
|
||||
.gpio21 = GPIO_DIR_INPUT,
|
||||
.gpio24 = GPIO_DIR_OUTPUT,
|
||||
.gpio25 = GPIO_DIR_OUTPUT,
|
||||
.gpio26 = GPIO_DIR_OUTPUT,
|
||||
.gpio27 = GPIO_DIR_OUTPUT,
|
||||
.gpio28 = GPIO_DIR_OUTPUT,
|
||||
};
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||||
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||||
const struct pch_gpio_set1 pch_gpio_set1_level = {
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||||
.gpio0 = GPIO_LEVEL_LOW,
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||||
.gpio11 = GPIO_LEVEL_HIGH,
|
||||
.gpio16 = GPIO_LEVEL_LOW,
|
||||
.gpio18 = GPIO_LEVEL_HIGH,
|
||||
.gpio20 = GPIO_LEVEL_HIGH,
|
||||
.gpio24 = GPIO_LEVEL_LOW,
|
||||
.gpio25 = GPIO_LEVEL_HIGH,
|
||||
.gpio26 = GPIO_LEVEL_LOW,
|
||||
.gpio27 = GPIO_LEVEL_LOW,
|
||||
.gpio28 = GPIO_LEVEL_LOW,
|
||||
};
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||||
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||||
const struct pch_gpio_set1 pch_gpio_set1_blink = {
|
||||
};
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||||
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||||
const struct pch_gpio_set1 pch_gpio_set1_invert = {
|
||||
.gpio13 = GPIO_INVERT,
|
||||
.gpio14 = GPIO_INVERT,
|
||||
};
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||||
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||||
const struct pch_gpio_set2 pch_gpio_set2_mode = {
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||||
.gpio32 = GPIO_MODE_NATIVE,
|
||||
.gpio33 = GPIO_MODE_NATIVE,
|
||||
.gpio34 = GPIO_MODE_NATIVE,
|
||||
.gpio35 = GPIO_MODE_NATIVE,
|
||||
.gpio36 = GPIO_MODE_NATIVE,
|
||||
.gpio37 = GPIO_MODE_NATIVE,
|
||||
.gpio38 = GPIO_MODE_NATIVE,
|
||||
.gpio39 = GPIO_MODE_NATIVE,
|
||||
};
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||||
|
||||
const struct pch_gpio_set2 pch_gpio_set2_direction = {
|
||||
.gpio32 = GPIO_DIR_OUTPUT,
|
||||
.gpio33 = GPIO_DIR_OUTPUT,
|
||||
.gpio34 = GPIO_DIR_OUTPUT,
|
||||
.gpio35 = GPIO_DIR_OUTPUT,
|
||||
.gpio36 = GPIO_DIR_INPUT,
|
||||
.gpio37 = GPIO_DIR_INPUT,
|
||||
.gpio38 = GPIO_DIR_INPUT,
|
||||
.gpio39 = GPIO_DIR_INPUT,
|
||||
};
|
||||
|
||||
const struct pch_gpio_set2 pch_gpio_set2_level = {
|
||||
.gpio32 = GPIO_LEVEL_HIGH,
|
||||
.gpio33 = GPIO_LEVEL_HIGH,
|
||||
.gpio34 = GPIO_LEVEL_LOW,
|
||||
.gpio35 = GPIO_LEVEL_LOW,
|
||||
};
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||||
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||||
const struct pch_gpio_map mainboard_gpio_map = {
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||||
.set1 = {
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||||
.mode = &pch_gpio_set1_mode,
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||||
.direction = &pch_gpio_set1_direction,
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||||
.level = &pch_gpio_set1_level,
|
||||
.blink = &pch_gpio_set1_blink,
|
||||
.invert = &pch_gpio_set1_invert,
|
||||
},
|
||||
.set2 = {
|
||||
.mode = &pch_gpio_set2_mode,
|
||||
.direction = &pch_gpio_set2_direction,
|
||||
.level = &pch_gpio_set2_level,
|
||||
},
|
||||
};
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||||
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@ -44,23 +44,6 @@
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#define SERIAL_DEV PNP_DEV(0x2e, W83627DHG_SP1)
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#define GPIO_DEV PNP_DEV(0x2e, W83627DHG_GPIO2345_V)
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void setup_ich7_gpios(void)
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{
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/* TODO: This is highly board specific and should be moved */
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printk(BIOS_DEBUG, " GPIOS...");
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/* General Registers */
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outl(0x1f3dffc1, DEFAULT_GPIOBASE + 0x00); /* GPIO_USE_SEL */
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||||
outl(0xe0e8f7c2, DEFAULT_GPIOBASE + 0x04); /* GP_IO_SEL */
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||||
outl(0xe2febb7e, DEFAULT_GPIOBASE + 0x0c); /* GP_LVL */
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||||
/* Output Control Registers */
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||||
outl(0x00000000, DEFAULT_GPIOBASE + 0x18); /* GPO_BLINK */
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||||
/* Input Control Registers */
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||||
outl(0x00006000, DEFAULT_GPIOBASE + 0x2c); /* GPI_INV */
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||||
outl(0x000000ff, DEFAULT_GPIOBASE + 0x30); /* GPIO_USE_SEL2 */
|
||||
outl(0x000000f0, DEFAULT_GPIOBASE + 0x34); /* GP_IO_SEL2 */
|
||||
outl(0x00030033, DEFAULT_GPIOBASE + 0x38); /* GP_LVL2 */
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||||
}
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/*
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* BSEL0 is connected with GPIO32
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* BSEL1 is connected with GPIO33 with inversed logic
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