mb/asus/p5q_se: Add initial support
This motherboard is almost identical to the ASUS P5QL PRO, with the only noticeable difference being that the ASUS P5Q SE has a P45 MCH while the P5QL PRO has a P43 MCH. Few changes were required. Signed-off-by: Hunter Sell <alicelyralain@gmail.com> Change-Id: I36612bac16a79f05f3fe57e535e4ba3c73790a86 Reviewed-on: https://review.coreboot.org/c/coreboot/+/55698 Tested-by: build bot (Jenkins) <no-reply@coreboot.org> Reviewed-by: Angel Pons <th3fanbus@gmail.com>
This commit is contained in:
Alice Sell
Werner Zeh
parent
9d5c94ac7a
commit
b5a8586fe4
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@ -1,6 +1,6 @@
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# SPDX-License-Identifier: GPL-2.0-only
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if BOARD_ASUS_P5QC || BOARD_ASUS_P5Q_PRO || BOARD_ASUS_P5QL_PRO || BOARD_ASUS_P5Q
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if BOARD_ASUS_P5QC || BOARD_ASUS_P5Q_PRO || BOARD_ASUS_P5QL_PRO || BOARD_ASUS_P5Q_SE || BOARD_ASUS_P5Q
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config BOARD_SPECIFIC_OPTIONS
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def_bool y
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@ -24,6 +24,7 @@ config VARIANT_DIR
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default "p5qc" if BOARD_ASUS_P5QC
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default "p5q_pro" if BOARD_ASUS_P5Q_PRO
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default "p5ql_pro" if BOARD_ASUS_P5QL_PRO
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||||
default "p5q_se" if BOARD_ASUS_P5Q_SE
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default "p5q" if BOARD_ASUS_P5Q
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config MAINBOARD_PART_NUMBER
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@ -31,6 +32,7 @@ config MAINBOARD_PART_NUMBER
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default "P5QC" if BOARD_ASUS_P5QC
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||||
default "P5Q PRO" if BOARD_ASUS_P5Q_PRO
|
||||
default "P5QL PRO" if BOARD_ASUS_P5QL_PRO
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||||
default "P5Q SE" if BOARD_ASUS_P5Q_SE
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default "P5Q" if BOARD_ASUS_P5Q
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config DEVICETREE
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@ -39,6 +41,7 @@ config DEVICETREE
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config GPIO_C
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string
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||||
default "variants/p5q_se/gpio.c" if BOARD_ASUS_P5Q_SE
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||||
default "variants/p5ql_pro/gpio.c" if BOARD_ASUS_P5QL_PRO
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||||
default "gpio.c"
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||||
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||||
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@ -49,7 +52,7 @@ config GPIO_C
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||||
config PAYLOAD_CONFIGFILE
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||||
string
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||||
default "" if PAYLOAD_SEABIOS && BOARD_ASUS_P5QL_PRO
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||||
default "" if PAYLOAD_SEABIOS && (BOARD_ASUS_P5QL_PRO || BOARD_ASUS_P5Q_SE)
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||||
default "\$(top)/src/mainboard/\$(MAINBOARDDIR)/config_seabios" if PAYLOAD_SEABIOS
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||||
endif # BOARD_ASUS_P5Q*
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@ -7,5 +7,8 @@ config BOARD_ASUS_P5Q_PRO
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config BOARD_ASUS_P5QL_PRO
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bool "P5QL PRO"
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config BOARD_ASUS_P5Q_SE
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bool "P5Q SE"
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config BOARD_ASUS_P5Q
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bool "P5Q"
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@ -0,0 +1,112 @@
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# SPDX-License-Identifier: GPL-2.0-or-later
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chip northbridge/intel/x4x # Northbridge
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device cpu_cluster 0 on # APIC cluster
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chip cpu/intel/socket_LGA775
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device lapic 0 on end
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end
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chip cpu/intel/model_1067x # CPU
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device lapic 0xacac off end
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||||
end
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||||
end
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device domain 0 on # PCI domain
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device pci 0.0 on end # Host Bridge
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device pci 1.0 on end # PEG
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device pci 2.0 off end # Integrated graphics controller
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device pci 2.1 off end # Integrated graphics controller 2
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||||
device pci 3.0 off end # ME
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device pci 3.1 off end # ME
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||||
device pci 3.2 off end # ME
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||||
device pci 3.3 off end # ME
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||||
device pci 6.0 off end # PEG 2
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chip southbridge/intel/i82801jx # Southbridge
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register "gpe0_en" = "0x40"
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register "sata_port_map" = "0x3f"
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||||
# Enable PCIe ports 0,2,3 as slots.
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register "pcie_slot_implemented" = "0x31"
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||||
register "gen1_dec" = "0x00000295"
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||||
register "gen2_dec" = "0x001c4701"
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||||
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||||
device pci 19.0 off end # GBE
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||||
device pci 1a.0 on end # USB
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||||
device pci 1a.1 on end # USB
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||||
device pci 1a.2 on end # USB
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||||
device pci 1a.7 on end # USB
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||||
device pci 1b.0 on end # Audio
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||||
device pci 1c.0 on end # PCIe 1 PCIe x1 Slot #1
|
||||
device pci 1c.1 on end # PCIe 2 PCIe x1 Slot #2
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device pci 1c.2 off end # PCIe 3
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||||
device pci 1c.3 off end # PCIe 4
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||||
device pci 1c.4 on end # PCIe 5 Marvell IDE
|
||||
device pci 1c.5 on end # PCIe 6 Atheros LAN
|
||||
device pci 1d.0 on end # USB
|
||||
device pci 1d.1 on end # USB
|
||||
device pci 1d.2 on end # USB
|
||||
device pci 1d.7 on end # USB
|
||||
device pci 1e.0 on end # PCI bridge
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||||
device pci 1f.0 on # LPC bridge
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||||
chip superio/winbond/w83667hg-a # Super I/O
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||||
device pnp 2e.0 on # FDC
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||||
# Global registers
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irq 0x2a = 0x30
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irq 0x2c = 0x22
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||||
irq 0x2d = 0x00
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||||
io 0x60 = 0x3f0
|
||||
irq 0x70 = 0x06
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||||
end
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||||
device pnp 2e.1 off end # LPT1
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||||
device pnp 2e.2 on # COM1
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io 0x60 = 0x3f8
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||||
irq 0x70 = 4
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||||
end
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||||
device pnp 2e.3 off end # COM2
|
||||
device pnp 2e.5 on # PS/2 keyboard & mouse
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||||
io 0x60 = 0x60
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||||
io 0x62 = 0x64
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||||
irq 0x70 = 1
|
||||
irq 0x72 = 12
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||||
end
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||||
device pnp 2e.106 off end # SPI1
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||||
device pnp 2e.107 off end # GPIO6
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device pnp 2e.207 off end # GPIO7
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device pnp 2e.307 on # GPIO8
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||||
irq 0xe4 = 0xfb
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||||
irq 0xe5 = 0x82
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||||
end
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||||
device pnp 2e.407 off end # GPIO9
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device pnp 2e.8 off end # WDT
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device pnp 2e.108 off end # GPIO1
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device pnp 2e.9 off end # GPIO2
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device pnp 2e.109 on end # GPIO3
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||||
device pnp 2e.209 on # GPIO4
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||||
irq 0xf0 = 0xff
|
||||
irq 0xfe = 0x07
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||||
end
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||||
device pnp 2e.309 on end # GPIO5
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||||
device pnp 2e.a on # ACPI
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||||
irq 0xe4 = 0x10 # 3VSBSW# enable
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||||
irq 0xe5 = 0x02
|
||||
irq 0xf2 = 0xfc
|
||||
end
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||||
device pnp 2e.b on # HW Monitor
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||||
io 0x60 = 0x290
|
||||
irq 0x70 = 0x0
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||||
# IRQ purposefully not assigned to prevent lockups
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||||
end
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||||
device pnp 2e.c on end # PECI
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device pnp 2e.d on end # VID_BUSSEL
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device pnp 2e.f on end # GPIO_PP_OD
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||||
end
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||||
end
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device pci 1f.1 off end # PATA/IDE
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device pci 1f.2 on end # SATA
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device pci 1f.3 on end # SMbus
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device pci 1f.4 off end
|
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device pci 1f.5 off end # IDE
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device pci 1f.6 on end # Thermal
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||||
end
|
||||
end
|
||||
end
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||||
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@ -0,0 +1,147 @@
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/* SPDX-License-Identifier: GPL-2.0-only */
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||||
#include <southbridge/intel/common/gpio.h>
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||||
static const struct pch_gpio_set1 pch_gpio_set1_mode = {
|
||||
.gpio1 = GPIO_MODE_GPIO,
|
||||
.gpio2 = GPIO_MODE_GPIO,
|
||||
.gpio3 = GPIO_MODE_GPIO,
|
||||
.gpio4 = GPIO_MODE_GPIO,
|
||||
.gpio5 = GPIO_MODE_GPIO,
|
||||
.gpio6 = GPIO_MODE_GPIO,
|
||||
.gpio7 = GPIO_MODE_GPIO,
|
||||
.gpio8 = GPIO_MODE_GPIO,
|
||||
.gpio9 = GPIO_MODE_GPIO,
|
||||
.gpio10 = GPIO_MODE_GPIO,
|
||||
.gpio11 = GPIO_MODE_GPIO,
|
||||
.gpio12 = GPIO_MODE_GPIO,
|
||||
.gpio13 = GPIO_MODE_GPIO,
|
||||
.gpio14 = GPIO_MODE_GPIO,
|
||||
.gpio15 = GPIO_MODE_GPIO,
|
||||
.gpio17 = GPIO_MODE_GPIO,
|
||||
.gpio18 = GPIO_MODE_GPIO,
|
||||
.gpio19 = GPIO_MODE_GPIO,
|
||||
.gpio20 = GPIO_MODE_GPIO,
|
||||
.gpio21 = GPIO_MODE_GPIO,
|
||||
.gpio22 = GPIO_MODE_GPIO,
|
||||
.gpio23 = GPIO_MODE_GPIO,
|
||||
.gpio27 = GPIO_MODE_GPIO,
|
||||
.gpio28 = GPIO_MODE_GPIO,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_direction = {
|
||||
.gpio1 = GPIO_DIR_OUTPUT,
|
||||
.gpio2 = GPIO_DIR_OUTPUT,
|
||||
.gpio3 = GPIO_DIR_OUTPUT,
|
||||
.gpio4 = GPIO_DIR_OUTPUT,
|
||||
.gpio5 = GPIO_DIR_OUTPUT,
|
||||
.gpio6 = GPIO_DIR_OUTPUT,
|
||||
.gpio7 = GPIO_DIR_INPUT,
|
||||
.gpio8 = GPIO_DIR_INPUT,
|
||||
.gpio9 = GPIO_DIR_OUTPUT,
|
||||
.gpio10 = GPIO_DIR_INPUT,
|
||||
.gpio11 = GPIO_DIR_OUTPUT,
|
||||
.gpio12 = GPIO_DIR_OUTPUT,
|
||||
.gpio13 = GPIO_DIR_INPUT,
|
||||
.gpio14 = GPIO_DIR_OUTPUT,
|
||||
.gpio15 = GPIO_DIR_INPUT,
|
||||
.gpio17 = GPIO_DIR_OUTPUT,
|
||||
.gpio18 = GPIO_DIR_OUTPUT,
|
||||
.gpio19 = GPIO_DIR_INPUT,
|
||||
.gpio20 = GPIO_DIR_OUTPUT,
|
||||
.gpio21 = GPIO_DIR_OUTPUT,
|
||||
.gpio22 = GPIO_DIR_OUTPUT,
|
||||
.gpio23 = GPIO_DIR_OUTPUT,
|
||||
.gpio24 = GPIO_DIR_OUTPUT,
|
||||
.gpio27 = GPIO_DIR_OUTPUT,
|
||||
.gpio28 = GPIO_DIR_OUTPUT,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_level = {
|
||||
.gpio1 = GPIO_LEVEL_HIGH,
|
||||
.gpio2 = GPIO_LEVEL_HIGH,
|
||||
.gpio3 = GPIO_LEVEL_HIGH,
|
||||
.gpio4 = GPIO_LEVEL_HIGH,
|
||||
.gpio5 = GPIO_LEVEL_HIGH,
|
||||
.gpio6 = GPIO_LEVEL_HIGH,
|
||||
.gpio9 = GPIO_LEVEL_LOW,
|
||||
.gpio11 = GPIO_LEVEL_HIGH,
|
||||
.gpio12 = GPIO_LEVEL_LOW,
|
||||
.gpio14 = GPIO_LEVEL_HIGH,
|
||||
.gpio17 = GPIO_LEVEL_HIGH,
|
||||
.gpio18 = GPIO_LEVEL_HIGH,
|
||||
.gpio20 = GPIO_LEVEL_HIGH,
|
||||
.gpio21 = GPIO_LEVEL_HIGH,
|
||||
.gpio22 = GPIO_LEVEL_HIGH,
|
||||
.gpio23 = GPIO_LEVEL_HIGH,
|
||||
.gpio24 = GPIO_LEVEL_LOW,
|
||||
.gpio27 = GPIO_LEVEL_HIGH,
|
||||
.gpio28 = GPIO_LEVEL_LOW,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_invert = {
|
||||
.gpio7 = GPIO_INVERT,
|
||||
.gpio10 = GPIO_INVERT,
|
||||
.gpio13 = GPIO_INVERT,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set2 pch_gpio_set2_mode = {
|
||||
.gpio32 = GPIO_MODE_GPIO,
|
||||
.gpio33 = GPIO_MODE_GPIO,
|
||||
.gpio34 = GPIO_MODE_GPIO,
|
||||
.gpio35 = GPIO_MODE_GPIO,
|
||||
.gpio36 = GPIO_MODE_GPIO,
|
||||
.gpio37 = GPIO_MODE_GPIO,
|
||||
.gpio38 = GPIO_MODE_GPIO,
|
||||
.gpio39 = GPIO_MODE_GPIO,
|
||||
.gpio48 = GPIO_MODE_GPIO,
|
||||
.gpio49 = GPIO_MODE_GPIO,
|
||||
.gpio56 = GPIO_MODE_GPIO,
|
||||
.gpio57 = GPIO_MODE_GPIO,
|
||||
.gpio60 = GPIO_MODE_GPIO,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set2 pch_gpio_set2_direction = {
|
||||
.gpio32 = GPIO_DIR_OUTPUT,
|
||||
.gpio33 = GPIO_DIR_OUTPUT,
|
||||
.gpio34 = GPIO_DIR_OUTPUT,
|
||||
.gpio35 = GPIO_DIR_OUTPUT,
|
||||
.gpio36 = GPIO_DIR_OUTPUT,
|
||||
.gpio37 = GPIO_DIR_OUTPUT,
|
||||
.gpio38 = GPIO_DIR_OUTPUT,
|
||||
.gpio39 = GPIO_DIR_OUTPUT,
|
||||
.gpio48 = GPIO_DIR_OUTPUT,
|
||||
.gpio49 = GPIO_DIR_OUTPUT,
|
||||
.gpio56 = GPIO_DIR_OUTPUT,
|
||||
.gpio57 = GPIO_DIR_INPUT,
|
||||
.gpio60 = GPIO_DIR_OUTPUT,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set2 pch_gpio_set2_level = {
|
||||
.gpio32 = GPIO_LEVEL_HIGH,
|
||||
.gpio33 = GPIO_LEVEL_HIGH,
|
||||
.gpio34 = GPIO_LEVEL_LOW,
|
||||
.gpio35 = GPIO_LEVEL_LOW,
|
||||
.gpio36 = GPIO_LEVEL_HIGH,
|
||||
.gpio37 = GPIO_LEVEL_HIGH,
|
||||
.gpio38 = GPIO_LEVEL_HIGH,
|
||||
.gpio39 = GPIO_LEVEL_HIGH,
|
||||
.gpio48 = GPIO_LEVEL_LOW,
|
||||
.gpio49 = GPIO_LEVEL_HIGH,
|
||||
.gpio56 = GPIO_LEVEL_HIGH,
|
||||
.gpio60 = GPIO_LEVEL_HIGH,
|
||||
};
|
||||
|
||||
const struct pch_gpio_map mainboard_gpio_map = {
|
||||
.set1 = {
|
||||
.mode = &pch_gpio_set1_mode,
|
||||
.direction = &pch_gpio_set1_direction,
|
||||
.level = &pch_gpio_set1_level,
|
||||
.invert = &pch_gpio_set1_invert,
|
||||
},
|
||||
.set2 = {
|
||||
.mode = &pch_gpio_set2_mode,
|
||||
.direction = &pch_gpio_set2_direction,
|
||||
.level = &pch_gpio_set2_level,
|
||||
},
|
||||
};
|
||||
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