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<gpio.h> chain-include <soc/gpio.h>. Change-Id: If2af7f77e2d910a3f3470d15dbfc98775a2633b6 Signed-off-by: Elyes Haouas <ehaouas@noos.fr> Reviewed-on: https://review.coreboot.org/c/coreboot/+/71813 Tested-by: build bot (Jenkins) <no-reply@coreboot.org> Reviewed-by: Hung-Te Lin <hungte@chromium.org>
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/* SPDX-License-Identifier: GPL-2.0-only OR MIT */
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#include <commonlib/stdlib.h>
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#include <console/console.h>
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#include <device/mmio.h>
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#include <device/resource.h>
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#include <delay.h>
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#include <gpio.h>
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#include <soc/addressmap.h>
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#include <soc/early_init.h>
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#include <soc/pcie.h>
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#include <soc/pcie_common.h>
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#include <stdlib.h>
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#include <string.h>
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#define PCIE_REG_BASE_PORT0 0x112f0000
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#define PCIE_RST_CTRL_REG (PCIE_REG_BASE_PORT0 + 0x148)
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#define PCIE_MAC_RSTB BIT(0)
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#define PCIE_PHY_RSTB BIT(1)
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#define PCIE_BRG_RSTB BIT(2)
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#define PCIE_PE_RSTB BIT(3)
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struct pad_func {
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gpio_t gpio;
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u8 func;
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};
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#define PAD_FUNC(name, func) {GPIO(name), PAD_##name##_FUNC_##func}
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static const struct pad_func pcie_pins[2][3] = {
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{
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PAD_FUNC(PCIE_WAKE_N, WAKEN),
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PAD_FUNC(PCIE_PERESET_N, PERSTN),
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PAD_FUNC(PCIE_CLKREQ_N, CLKREQN),
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|
},
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|
{
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|
PAD_FUNC(CMMCLK0, PERSTN_1),
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|
PAD_FUNC(CMMCLK1, CLKREQN_1),
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|
PAD_FUNC(CMMCLK2, WAKEN_1),
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|
},
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|
};
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static void mtk_pcie_set_pinmux(uint8_t port)
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{
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const struct pad_func *pins = pcie_pins[port];
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size_t i;
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for (i = 0; i < ARRAY_SIZE(pcie_pins[port]); i++) {
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gpio_set_mode(pins[i].gpio, pins[i].func);
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gpio_set_pull(pins[i].gpio, GPIO_PULL_ENABLE, GPIO_PULL_UP);
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}
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}
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void mtk_pcie_reset(uintptr_t reg, bool enable)
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{
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uint32_t val;
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val = read32p(reg);
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if (enable)
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val |= PCIE_MAC_RSTB | PCIE_PHY_RSTB | PCIE_BRG_RSTB |
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PCIE_PE_RSTB;
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else
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val &= ~(PCIE_MAC_RSTB | PCIE_PHY_RSTB | PCIE_BRG_RSTB |
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PCIE_PE_RSTB);
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write32p(reg, val);
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}
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void mtk_pcie_pre_init(void)
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{
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mtk_pcie_set_pinmux(0);
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/* Assert all reset signals at early stage */
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mtk_pcie_reset(PCIE_RST_CTRL_REG, true);
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early_init_save_time(EARLY_INIT_PCIE);
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}
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