e8e66f4763
Use shared gpio code from common folder. Bd82x6x's gpio.c and gpio.h is used by other southbridges as well and will be removed once it is unused. Change-Id: I8bd981c4696c174152cf41caefa6c083650d283a Signed-off-by: Patrick Rudolph <siro@das-labor.org> Reviewed-on: https://review.coreboot.org/13614 Tested-by: build bot (Jenkins) Reviewed-by: Martin Roth <martinroth@google.com>
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C
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C
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* This file is part of the coreboot project.
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* Copyright (C) 2011 The Chromium OS Authors. All rights reserved.
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* Copyright (C) 2014 Vladimir Serbinenko
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* This program is free software; you can redistribute it and/or modify
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* it under the terms of the GNU General Public License as published by
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* the Free Software Foundation; version 2 of the License.
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* This program is distributed in the hope that it will be useful,
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* but WITHOUT ANY WARRANTY; without even the implied warranty of
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* MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
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* GNU General Public License for more details.
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*/
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#ifndef X230_GPIO_H
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#define X230_GPIO_H
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#include <southbridge/intel/common/gpio.h>
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const struct pch_gpio_set1 pch_gpio_set1_mode = {
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.gpio0 = GPIO_MODE_GPIO,
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.gpio1 = GPIO_MODE_GPIO,
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.gpio2 = GPIO_MODE_GPIO,
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.gpio3 = GPIO_MODE_GPIO,
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.gpio4 = GPIO_MODE_GPIO,
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.gpio5 = GPIO_MODE_GPIO,
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.gpio6 = GPIO_MODE_GPIO,
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.gpio7 = GPIO_MODE_GPIO,
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.gpio8 = GPIO_MODE_GPIO,
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.gpio9 = GPIO_MODE_NATIVE,
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.gpio10 = GPIO_MODE_GPIO,
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.gpio11 = GPIO_MODE_NATIVE,
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.gpio12 = GPIO_MODE_NATIVE,
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.gpio13 = GPIO_MODE_GPIO,
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.gpio14 = GPIO_MODE_NATIVE,
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|
.gpio15 = GPIO_MODE_GPIO,
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.gpio16 = GPIO_MODE_NATIVE,
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|
.gpio17 = GPIO_MODE_GPIO,
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|
.gpio18 = GPIO_MODE_NATIVE,
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|
.gpio19 = GPIO_MODE_NATIVE,
|
|
.gpio20 = GPIO_MODE_NATIVE,
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|
.gpio21 = GPIO_MODE_GPIO,
|
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.gpio22 = GPIO_MODE_GPIO,
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|
.gpio23 = GPIO_MODE_NATIVE,
|
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.gpio24 = GPIO_MODE_GPIO,
|
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.gpio25 = GPIO_MODE_NATIVE,
|
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.gpio26 = GPIO_MODE_NATIVE,
|
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.gpio27 = GPIO_MODE_GPIO,
|
|
.gpio28 = GPIO_MODE_GPIO,
|
|
.gpio29 = GPIO_MODE_GPIO,
|
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.gpio30 = GPIO_MODE_NATIVE,
|
|
.gpio31 = GPIO_MODE_NATIVE,
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|
};
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const struct pch_gpio_set1 pch_gpio_set1_direction = {
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.gpio0 = GPIO_DIR_INPUT,
|
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.gpio1 = GPIO_DIR_INPUT,
|
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.gpio2 = GPIO_DIR_INPUT,
|
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.gpio3 = GPIO_DIR_INPUT,
|
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.gpio4 = GPIO_DIR_INPUT,
|
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.gpio5 = GPIO_DIR_INPUT,
|
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.gpio6 = GPIO_DIR_INPUT,
|
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.gpio7 = GPIO_DIR_INPUT,
|
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.gpio8 = GPIO_DIR_OUTPUT,
|
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.gpio9 = GPIO_DIR_INPUT,
|
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.gpio10 = GPIO_DIR_OUTPUT,
|
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.gpio11 = GPIO_DIR_INPUT,
|
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.gpio12 = GPIO_DIR_OUTPUT,
|
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.gpio13 = GPIO_DIR_INPUT,
|
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.gpio14 = GPIO_DIR_INPUT,
|
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.gpio15 = GPIO_DIR_OUTPUT,
|
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.gpio16 = GPIO_DIR_INPUT,
|
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.gpio17 = GPIO_DIR_INPUT,
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.gpio18 = GPIO_DIR_INPUT,
|
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|
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.gpio20 = GPIO_DIR_INPUT,
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.gpio21 = GPIO_DIR_INPUT,
|
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.gpio22 = GPIO_DIR_OUTPUT,
|
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.gpio23 = GPIO_DIR_INPUT,
|
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.gpio24 = GPIO_DIR_OUTPUT,
|
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.gpio25 = GPIO_DIR_INPUT,
|
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.gpio26 = GPIO_DIR_INPUT,
|
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.gpio27 = GPIO_DIR_INPUT,
|
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.gpio28 = GPIO_DIR_OUTPUT,
|
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.gpio29 = GPIO_DIR_OUTPUT,
|
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.gpio30 = GPIO_DIR_OUTPUT,
|
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.gpio31 = GPIO_DIR_INPUT
|
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};
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const struct pch_gpio_set1 pch_gpio_set1_level = {
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|
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.gpio1 = GPIO_LEVEL_HIGH,
|
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|
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|
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.gpio4 = GPIO_LEVEL_HIGH,
|
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|
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.gpio6 = GPIO_LEVEL_HIGH,
|
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.gpio7 = GPIO_LEVEL_HIGH,
|
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.gpio8 = GPIO_LEVEL_LOW,
|
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.gpio9 = GPIO_LEVEL_HIGH,
|
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.gpio10 = GPIO_LEVEL_HIGH,
|
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.gpio11 = GPIO_LEVEL_HIGH,
|
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.gpio12 = GPIO_LEVEL_HIGH,
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|
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|
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|
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.gpio28 = GPIO_LEVEL_LOW,
|
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|
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.gpio30 = GPIO_LEVEL_HIGH,
|
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.gpio31 = GPIO_LEVEL_LOW,
|
|
};
|
|
|
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const struct pch_gpio_set1 pch_gpio_set1_invert = {
|
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.gpio1 = GPIO_INVERT,
|
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.gpio6 = GPIO_INVERT,
|
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.gpio13 = GPIO_INVERT,
|
|
};
|
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const struct pch_gpio_set2 pch_gpio_set2_mode = {
|
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.gpio32 = GPIO_MODE_NATIVE,
|
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|
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|
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|
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|
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|
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.gpio38 = GPIO_MODE_GPIO,
|
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.gpio39 = GPIO_MODE_GPIO,
|
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.gpio41 = GPIO_MODE_NATIVE,
|
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.gpio42 = GPIO_MODE_NATIVE,
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.gpio43 = GPIO_MODE_GPIO,
|
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.gpio44 = GPIO_MODE_NATIVE,
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.gpio45 = GPIO_MODE_NATIVE,
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.gpio46 = GPIO_MODE_NATIVE,
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.gpio51 = GPIO_MODE_GPIO,
|
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.gpio52 = GPIO_MODE_GPIO,
|
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|
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|
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|
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.gpio56 = GPIO_MODE_NATIVE,
|
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.gpio57 = GPIO_MODE_GPIO,
|
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.gpio58 = GPIO_MODE_NATIVE,
|
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|
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.gpio60 = GPIO_MODE_NATIVE,
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|
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|
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};
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const struct pch_gpio_set2 pch_gpio_set2_direction = {
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const struct pch_gpio_set2 pch_gpio_set2_level = {
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.gpio36 = GPIO_LEVEL_LOW,
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.gpio39 = GPIO_LEVEL_LOW,
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.gpio42 = GPIO_LEVEL_HIGH,
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.gpio45 = GPIO_LEVEL_HIGH,
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.gpio46 = GPIO_LEVEL_HIGH,
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.gpio47 = GPIO_LEVEL_HIGH,
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.gpio48 = GPIO_LEVEL_HIGH,
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.gpio49 = GPIO_LEVEL_HIGH,
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.gpio50 = GPIO_LEVEL_HIGH,
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.gpio51 = GPIO_LEVEL_HIGH,
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.gpio52 = GPIO_LEVEL_HIGH,
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.gpio54 = GPIO_LEVEL_HIGH,
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.gpio55 = GPIO_LEVEL_HIGH,
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.gpio56 = GPIO_LEVEL_HIGH,
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.gpio57 = GPIO_LEVEL_HIGH,
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.gpio58 = GPIO_LEVEL_HIGH,
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.gpio60 = GPIO_LEVEL_HIGH,
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.gpio61 = GPIO_LEVEL_HIGH,
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const struct pch_gpio_set3 pch_gpio_set3_mode = {
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const struct pch_gpio_set3 pch_gpio_set3_direction = {
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.gpio71 = GPIO_DIR_INPUT,
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.gpio72 = GPIO_DIR_INPUT,
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const struct pch_gpio_set3 pch_gpio_set3_level = {
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const struct pch_gpio_map mainboard_gpio_map = {
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|
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|
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.set2 = {
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.mode = &pch_gpio_set2_mode,
|
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.direction = &pch_gpio_set2_direction,
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|
|
},
|
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.set3 = {
|
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.mode = &pch_gpio_set3_mode,
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|
.direction = &pch_gpio_set3_direction,
|
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.level = &pch_gpio_set3_level,
|
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},
|
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};
|
|
#endif
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