soc/intel/cannonlake: fix gpio pin numbers
Update pin numbers to match kernel cannonlake pinctrl driver. TEST=boot to OS Change-Id: Id65736db03200fd434dd9292ce081727abd6832b Signed-off-by: Bora Guvendik <bora.guvendik@intel.com> Reviewed-on: https://review.coreboot.org/22477 Reviewed-by: Aaron Durbin <adurbin@chromium.org> Tested-by: build bot (Jenkins) <no-reply@coreboot.org>
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a778237948
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@ -64,189 +64,193 @@
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#define GPD2 231
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#define GPD4 233
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#define GPD5 234
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#define GPD6 235
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#define GPD7 236
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#define GPD8 237
|
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#define GPD9 238
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#define GPD10 239
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#define GPD11 240
|
||||
|
||||
#define NUM_GPIO_COM2_PADS (GPD11 - GPD0 + 1)
|
||||
|
||||
#define TOTAL_PADS 188
|
||||
#define TOTAL_PADS 241
|
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#endif
|
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